CARATTERISTICHE
• Frequenza di clock: 166, 143, 133 MHz
• Completamente sincrono; tutti i segnali fanno riferimento a un bordo del clock positivo
• Banco interno per nascondere l'accesso alla fila / precarica
• Singola alimentazione: 3,3 V + 0,3 V
• Interfaccia LVTTL
• Lunghezza burst programmabile
- (1, 2, 4, 8, pagina intera)
• Sequenza burst programmabile: sequenziale / interleave
• Aggiornamento automatico (CBR)
• Aggiornamento automatico
• Cicli di aggiornamento 8 K ogni 32 ms (grado A2) o 64 ms (commerciale, industriale, grado A1)
• Indirizzo colonna casuale ogni ciclo di clock
• Latenza programmabile CAS (2, 3 orologi)
• Funzionalità di lettura / scrittura e burst burst read / single write
• Terminazione a raffica con comando di arresto a raffica e precarica

OPZIONI
• Pacchetto:
TSOP-II a 54 pin
BGA a 54 sfere
• Intervallo operativo di temperatura:
Commerciale (da 0oC a + 70oC)
Industriale (da -40 ° C a + 85 ° C)
Grado automobilistico A1 (da -40 ° C a + 85 ° C)
Grado automobilistico A2 (da -40 ° C a + 105 ° C)

PANORAMICA
La DRAM sincrona da 256 Mb di ISSI consente il trasferimento di dati ad alta velocità utilizzando l'architettura della pipeline. Tutti i segnali di ingresso e uscita si riferiscono al fronte di salita dell'ingresso di clock. La SDRAM da 256 MB è organizzata come segue.

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