Caratteristiche

• Caratteristiche operative

- Intervallo di tensione da 3 V a 3,6 V

- Intervallo di temperatura (ambiente) da -40 ° C a 85 ° C

• Funzionalità ARM® Cortex® A5 Core

- Fino a 500 MHz ARM Cortex A5 - 32 KB / 32 KB I / D L1 Cache

- 1.6 DMIPS / MHz basato sull'architettura ARMv7 - Coprocessore NEON ™ MPE (Media Processing Engine)

- Unità a virgola mobile a doppia precisione

- 512 KB di cache L2 (solo su numeri di parte selezionati)

• Funzionalità ARM Cortex M4 Core

- ARM Cortex M4 fino a 167 MHz

- Funzionalità DSP integrata

- 64 KB di memoria Tightly Coupled (TCM)

- 16 KB / 16 KB di cache I / D L1

- 1,25 DMIPS / MHz basato sull'architettura ARMv7

• Orologi

- Oscillatore a cristallo a 24 MHz

- Oscillatore a cristallo 32 kHz

- Clock di riferimento interni (128 KHz e 24 MHz)

- Circuiti a blocco di fase (PLL)

- PLL digitali a basso jitter

• Debug, protezione e gestione dell'alimentazione del sistema

- Varie modalità di arresto, attesa ed esecuzione per fornire bassa potenza in base alle esigenze dell'applicazione

- Il registro di abilitazione dell'orologio periferico può disabilitare gli orologi ai moduli non utilizzati, riducendo così le correnti

- Avviso di bassa tensione e rilevamento con punti di intervento selezionabili

- Opcode illegale e rilevamento di indirizzi illegali con reset programmabile o risposta di eccezione del processore

- Modulo CRC hardware per supportare rapidi controlli di ridondanza ciclici (CRC)

- Identificatore di chip univoco a 128 bit

- Cane da guardia hardware

- Monitor esterno del cane da guardia (EWM)

- Doppio controller DMA con 32 canali (con DMAMUX)

• Debug

- JTAG standard

- Porta di traccia a 16 bit

• Timer

- Controllo del motore / timer per uso generale (FTM)

- Temporizzatori di interruzione periodici (PIT)

- Timer a bassa potenza (LPTMR0)

- Timer IEEE 1588 per interfaccia MAC (parte del sottosistema Ethernet)

• Comunicazioni

- Sei ricevitori / trasmettitori asincroni universali (UART) / interfaccia di comunicazione seriale (SCI) con LIN, ISO7816, IrDA e controllo del flusso hardware

- Quattro Deserial Serial Periferical Interface (DSPI)

- Quattro circuiti integrati (I2C) con supporto SMBUS

- Doppio controller OTG USB + PHY

- Doppio controller host digitale sicuro a 4/8 bit

- Doppia Ethernet 10/100 con switch L2 (IEEE 1588)

- Dual FlexCAN3

• Sicurezza

- ARM TrustZone inclusa l'architettura TZ

- Modulo di accelerazione e garanzia crittografica, incorpora 16 KB di RAM sicura (CAAM)

- Archiviazione non volatile sicura, incluso Secure Real Time Clock (SNVS)

- Controllo in tempo reale dell'integrità (RTIC)

- Rilevazione di manomissioni - supportata da pin esterni, monitor di clock onchip, manometri di tensione e temperatura

- TrustZone Watchdog (TZ WDOG)

- Controller di spazio indirizzo Trust Area

- Unità centrale di sicurezza

- Proteggi JTAG

- High Assurance Boot (HAB) con supporto per l'avvio crittografato

• Interfacce di memoria

- Controller DRAM 8/16 bit con supporto per LPDDR2 / DDR3

- Fino a 400 MHz (ECC supportato solo per 8 bit e non 16 bit)

- Controller NAND Flash 8/16 bit con ECC

- Bus esterno 8/16/32 bit (Flexbus)

- Dual Quad SPI con XIP (Execute-In-Place)

• Display e video

- Dual Display Control Unit (DCU) con supporto per display TFT a colori fino a SVGA

- LCD segmentato (solo vetro 3V) configurabile come 40x4, 38x8 e 36x6

- Unità di interfaccia video (VIU) per telecamera

- Apri VG Graphics Processing Unit (GPU)

- VideoADC

• Analogico

- Doppio ADC SAR a 12 bit con 1MS / s

- Doppio DAC a 12 bit

• Audio

- Quattro Synchronous Audio Interface (SAI)

- Enhanced Serial Audio Interface (ESAI)

- Sony Philips Digital Interface (SPDIF), Rx e Tx

- Convertitore asincrono di frequenza di campionamento (ASRC)

• Interfaccia uomo-macchina (HMI)

- Pin GPIO con supporto per interrupt, capacità di richiesta DMA, filtro glitch digitale.

- Isteresi e dispositivo pull up / down configurabile su tutti i pin di ingresso

- Velocità di risposta configurabile e potenza dell'unità su tutti i pin di uscita

• Memoria su chip

- 512 KB SRAM su chip con ECC

- 1 MB di grafica su chip SRAM (no ECC). Questo dipende dalla parte selezionata. La configurazione alternativa potrebbe essere 512 KB di grafica e 512 KB di cache L2.

- ROM di avvio da 96 KB

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