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Notícia

MVF51NN151CMK50 FREESCALE BGA www.ic-stocks.com

  • Autor:lulu
  • Fonte:www.ic-stocks.com
  • Lançamento em:2019-08-05
Características

• Características operacionais

- faixa de tensão de 3 V a 3,6 V

- Faixa de temperatura (ambiente) -40 ° C a 85 ° C

• Recursos do ARM® Cortex® A5 Core

- Até 500 MHz ARM Cortex A5 - 32 KB / 32 KB I / D L1 Cache

- 1.6 DMIPS / MHz baseado na arquitetura ARMv7 - Coprocessador NEON ™ MPE (Media Processing Engine)

- Unidade de ponto flutuante de precisão dupla

- 512 KB de cache L2 (somente em números de peça selecionados)

• Recursos do ARM Cortex M4 Core

- Até 167 MHz ARM Cortex M4

- Capacidade integrada de DSP

- 64 KB de memória totalmente acoplada (TCM)

- 16 KB / 16 KB de cache I / D L1

- 1.25 DMIPS / MHz baseado na arquitetura ARMv7

• Relógios

- oscilador de cristal de 24 MHz

- oscilador de cristal de 32 kHz

- Relógios de referência interna (128 KHz e 24 MHz)

- Loops de fase bloqueada (PLLs)

- PLLs digitais de baixo jitter

• Depuração do sistema, proteção e gerenciamento de energia

- Vários modos de parada, espera e execução para fornecer baixa potência com base nas necessidades de aplicativos

- Registro de habilitação de relógio periférico pode desabilitar os relógios para módulos não utilizados, reduzindo assim as correntes

- Aviso de baixa voltagem e detecção com pontos de disparo selecionáveis

- Opcode ilegal e detecção de endereço ilegal com reset programável ou resposta de exceção do processador

- Módulo CRC de hardware para suportar verificações de redundância cíclica rápidas (CRC)

- identificador de chip exclusivo de 128 bits

- Watchdog de hardware

- Monitor externo de Watchdog (EWM)

- Controlador Dual DMA com 32 canais (com DMAMUX)

• Depurar

- JTAG padrão

- Porta de rastreio de 16 bits

• temporizadores

- Controle de motor / temporizador de uso geral (FTM)

- Temporizadores periódicos de interrupção (PITs)

- temporizador de baixa potência (LPTMR0)

- Temporizador IEEE 1588 por interface MAC (parte do subsistema Ethernet)

• Comunicações

- Seis receptores / transmissores assíncronos universais (UART) / interface de comunicação serial (SCI) com controle de fluxo LIN, ISO7816, IrDA e hardware

- Quatro interface periférica Serial Deserial (DSPI)

- Quatro Circuitos Integrados (I2C) com suporte a SMBUS

- Controlador Dual USB OTG + PHY

- Controlador host Secure Digital de 4/8 bits duplos

- Ethernet 10/100 dupla com interruptor L2 (IEEE 1588)

- Dual FlexCAN3

• Segurança

- ARM TrustZone incluindo a arquitetura TZ

- Módulo de Aceleração e Garantia Criptográfica, incorpora RAM segura de 16 KB (CAAM)

- Armazenamento Não Volátil Seguro, incluindo o Relógio de Tempo Real Seguro (SNVS)

- Verificador de Integridade em Tempo Real (RTIC)

- Detecção de adulteração - suportada por pinos externos, monitores de relógio onchip, supressores de tensão e temperatura

- Watchdog da TrustZone (TZ WDOG)

- Controlador de espaço de endereços da zona de confiança

- Unidade Central de Segurança

- JTAG seguro

- High Assurance Boot (HAB) com suporte para inicialização criptografada

• Interfaces de Memória

- Controlador DRAM de 8/16 bits com suporte para LPDDR2 / DDR3

- Até 400 MHz (compatível com ECC apenas para 8 bits e não para 16 bits)

- Controlador Flash NAND de 8/16 bits com ECC

- barramento externo de 8/16/32 bits (Flexbus)

- Dual Quad SPI com XIP (Execute-in-place)

• Display e Vídeo

- Unidade de controle de monitor duplo (DCU) com suporte para exibição TFT colorida até SVGA

- LCD segmentado (somente vidro de 3V) configurável como 40x4, 38x8 e 36x6

- Unidade de interface de vídeo (VIU) para câmera

- Unidade de processamento de gráficos Open VG (GPU)

- VideoADC

• analógico

- ADC SAR duplo de 12 bits com 1MS / s

- DAC dual de 12 bits

• Áudio

- Quatro Interface de Áudio Síncrona (SAI)

- Enhanced Serial Audio Interface (ESAI)

- Interface digital Sony Philips (SPDIF), Rx e Tx

- Conversor assíncrono de taxa de amostragem (ASRC)

• Interface homem-máquina (IHM)

- pinos GPIO com suporte a interrupção, capacidade de solicitação de DMA, filtro digital de falha.

- Histerese e dispositivo de subida / descida configurável em todos os pinos de entrada

- Taxa de variação configurável e força da unidade em todos os pinos de saída

• Memória On-Chip

- SRAM de 512 KB no chip com ECC

- 1 MB de gráficos no chip SRAM (sem ECC). Isso depende da parte selecionada. A configuração alternativa pode ser de 512 KB e 512 KB de cache L2.

- ROM de inicialização de 96 KB

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